AD9985A
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
80 79 78 77 76 75 74 73 72 71 70 69 68 67 66 65 64 63 62 61
GND 1
60
GND
GREEN <7> 2
GREEN <6> 3
GREEN <5> 4
GREEN <4> 5
GREEN <3> 6
GREEN <2> 7
GREEN <1> 8
GREEN <0> 9
GND 10
V DD 11
BLUE <7> 12
BLUE <6> 13
BLUE <5> 14
BLUE <4> 15
BLUE <3> 16
BLUE <2> 17
BLUE <1> 18
BLUE <0> 19
GND 20
PIN 1
AD9985A
TOP VIEW
(Not to Scale)
59
58
57
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
V D
REF BYPASS
SDA
SCL
A0
R IN
GND
V D
V D
GND
SOGIN
G IN
GND
V D
V D
GND
B IN
V D
GND
21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40
Figure 2. Pin Configuration
Table 4. Complete Pinout List
Pin Type
Inputs
Outputs
References
B
Mnemonic
R IN
G IN
B IN
HSYNC
VSYNC
SOGIN
CLAMP
COAST
Red [7:0]
Green [7:0]
Blue [7:0]
DATACK
HSOUT
VSOUT
SOGOUT
REF BYPASS
MIDSCV
FILT
Function
Analog Input for Converter R
Analog Input for Converter G
Analog Input for Converter B
Horizontal SYNC Input
Vertical SYNC Input
Input for Sync-on-Green
Clamp Input (External Clamp Signal)
PLL Coast Signal Input
Outputs of Converter Red, Bit 7 is the MSB
Outputs of Converter Green, Bit 7 is the MSB
Outputs of Converter Blue, Bit 7 is the MSB
Data Output Clock
HSYNC Output (Phase-Aligned with DATACK)
VSYNC Output (Phase-Aligned with DATACK)
Sync-on-Green Slicer Output
Internal Reference Bypass
Internal Midscale Voltage Bypass
Connection for External Filter Components
Value
0.0 V to 1.0 V
0.0 V to 1.0 V
0.0 V to 1.0 V
3.3 V CMOS
3.3 V CMOS
0.0 V to 1.0 V
3.3 V CMOS
3.3 V CMOS
3.3 V CMOS
3.3 V CMOS
3.3 V CMOS
3.3 V CMOS
3.3 V CMOS
3.3 V CMOS
3.3 V CMOS
1.25 V
Pin No.
54
48
43
30
31
49
38
29
70 to 77
2 to 9
12 to 19
67
66
64
65
58
37
33
for Internal PLL
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